H.264/AVC 복호기의 움직임 보상 하드웨어 설계에 관한 연구
저자
발행기관
학술지명
한밭대학교 논문집(JOURNAL OF TAEJON NATIONAL UNIVERSITY OF TECHNOLOGY)
권호사항
발행연도
2009
작성언어
Korean
KDC
051
자료형태
학술저널
수록면
103-109(7쪽)
제공처
본 논문에서는 H.264/AVC 복호기의 움직임 보상 하드웨어 구조를 설계하고 검증한다. H.264/
AVC 압축표준은 최신 압축표준으로서 기존의 MPEG-4 압축표준의 1.5배에 달하는 압축률을 자랑한다
설계된 H.264/AVC 복호기 움직임 보상 구조는 주로 핸드폰과 같은 휴대용 단말기에 사용하는 Baseline
프로파일에 속하고 영상 크기는 176x144 픽셀이다 움직임 보상에서 메모리 접근은 전체 H.264/AVC 복
호기 가운데서 45% 를 차지 할 수 있는데 공식 소프트웨어인 JM 소스에서 제안한 움직염 보상 알고리즘
은 하드웨어로 구현하기에는 여러 가지 문제가 존재 한다 JM 소스에서는 블록 사이즈와 관계없이 항상
4x4 블록에 대한 참조 블록을 패치 하는데 이것은 참조 블록의 중복성을 초래하고 불필요한 참조 픽셀을
패치 한다. 또한 픽엘 보간을 진행 할 때 수평방향과 수직방향에서 순차적으로 진행하여 최종적으로 처리
속도가 늦어진다. 이런 문제를 해결하기 위하여 본 논문에서는 움직임 보상 참조 블록에 대한 패치 사이
클을 줄이는데 초점을 두었다 설계된 하드웨어 구조는 Verilog HDL로 기술 되었고 YUV 파일을 JM14.0
부호기에서 부호화 하여 테스트 벡터로 사용하였고 최종적으로 시뮬레이션 검증을 진행하였다. 제안한 알
고리즘을 하드웨어로 구현한 결과 JM 소프트웨어에서 제안한 알고리즘과 비교할 때 최대 70.8%의 성능
향상을 가져 왔다
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