KCI등재
저전력 31.6 pJ/step 축차 근사형 용량-디지털 직접 변환 IC = Low Power 31.6 pJ/step Successive Approximation Direct Capacitance-to-Digital Converter
In this paper, an energy-efficient 11.49-bit successive approximation register (SAR) capacitance-to-digital converter (CDC) for capac- itive sensors with a figure of merit (FoM) of 31.6 pJ/conversion-step is presented. The CDC employs a SAR algorithm to obtain lowpower consumption and a simplified structure. The proposed circuit uses a capacitive sensing amplifier (CSA) and a dynamic latch com-parator to achieve parasitic capacitance-insensitive operation. The CSA adopts a correlated double sampling (CDS) technique to reduceflicker (1/f) noise to achieve low-noise characteristics. The SAR algorithm is implemented in dual operating mode, using an 8-bit coarse programmable capacitor array in the capacitance-domain and an 8-bit R-2R digital-to-analog converter (DAC) in the charge-domain.
The proposed CDC achieves a wide input capacitance range of 29.4 pF and a high resolution of 0.449 fF. The CDC is fabricated ina 0.18-µm 1P6M complementary metal-oxide-semiconductor (CMOS) process with an active area of 0.55 mm2. The total power con- sumption of the CDC is 86.4 µW with a 1.8-V supply. The SAR CDC achieves a measured 11.49-bit resolution within a conversion time of 1.025 ms and an energy-efficiency FoM of 31.6 pJ/step.
분석정보
연월일 | 이력구분 | 이력상세 | 등재구분 |
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2022 | 평가예정 | 계속평가 신청대상 (계속평가) | |
2021-12-01 | 평가 | 등재후보로 하락 (재인증) | KCI후보 |
2018-01-01 | 평가 | 등재학술지 선정 (계속평가) | KCI등재 |
2017-12-01 | 평가 | 등재후보로 하락 (계속평가) | KCI후보 |
2013-01-01 | 평가 | 등재 1차 FAIL (등재유지) | KCI등재 |
2010-01-01 | 평가 | 등재학술지 유지 (등재유지) | KCI등재 |
2008-01-01 | 평가 | 등재학술지 유지 (등재유지) | KCI등재 |
2005-01-01 | 평가 | 등재학술지 선정 (등재후보2차) | KCI등재 |
2004-01-01 | 평가 | 등재후보 1차 PASS (등재후보1차) | KCI후보 |
2002-07-01 | 평가 | 등재후보학술지 선정 (신규평가) | KCI후보 |
기준연도 | WOS-KCI 통합IF(2년) | KCIF(2년) | KCIF(3년) |
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2016 | 0.22 | 0.22 | 0.16 |
KCIF(4년) | KCIF(5년) | 중심성지수(3년) | 즉시성지수 |
0.15 | 0.13 | 0.319 | 0.07 |
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