시계열 패턴을 적용한 패키지 본딩 공정의 이상 감지
저자
발행기관
학술지명
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발행연도
2021
작성언어
Korean
자료형태
학술저널
수록면
123-128(6쪽)
제공처
Existing semiconductor defect inspection has relied on measurement between process steps or destruction inspection, in which only some wafers can be inspected according to production efficiency issues.
However, due to an issue that leads to a large loss of some wafers that were not inspected, it was possible to monitor the value of a facility sensor capable of inspecting the entire wafer.
In recent quality control, this sensor data is also added along with the existing inspection and is managed through statistical verification.
In addition, verification methods such as SPC, EWMA, APC, FDC, and VM are used to verify that specifications are satisfied with real-time time series values without considering the order of time series sensor values.
As defects increase as the process refines, the sensor value trend fluctuates according to the time series even within the set specification of the sensor value.
At this time, there is a need for a method capable of detecting an abnormal pattern by calculating the time-series correlation of the pattern for each wafer.
Pre-treatment was necessary for this method, but until now, only manual verification, which is verified after manual monitoring by humans, has been in progress.
Therefore, in this study, in order to improve the shortcomings of these existing verification methods, the problem of data transmission timing was solved by using the similarity measurement method and the deep learning method by using the time series pattern data collected in a specific process.
Several examples of real-time time-series abnormal pattern detection verified in the process were included.
In addition, through the process data with little bad label data, we compared the performance of various methods and proposed an optimal method that can be applied.
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