KCI등재
SCIE
SCOPUS
Systolic Arrays for Lattice-Reduction-Aided MIMO Detection
저자
Ni-Chun Wang (University of California-Los Angeles) ; Ezio Biglieri (University of California-Los Angeles) ; Kung Yao (University of California-Los Angeles)
발행기관
학술지명
Journal of communications and networks(Journal of Communications and Networks)
권호사항
발행연도
2011
작성언어
English
주제어
등재정보
KCI등재,SCIE,SCOPUS
자료형태
학술저널
수록면
481-493(13쪽)
KCI 피인용횟수
1
제공처
Multiple-inputmultiple-output (MIMO) technology provides high data rate and enhanced quality of service for wireless communications. Since the benefits from MIMO result in a heavy computational load in detectors, the design of low-complexity suboptimum receivers is currently an active area of research. Latticereduction-aided detection (LRAD) has been shown to be an effective low-complexity method with near-maximum-likelihood performance.
In this paper, we advocate the use of systolic array architectures for MIMO receivers, and in particular we exhibit one of them based on LRAD. The “Lenstra-Lenstra-Lov´asz (LLL) lattice reduction algorithm” and the ensuing linear detections or successive spatial-interference cancellations can be located in the same array, which is considerably hardware-efficient. Since the conventional form of the LLL algorithm is not immediately suitable for parallel processing, two modified LLL algorithms are considered here for the systolic array. LLL algorithm with full-size reduction-LLL is one of the versions more suitable for parallel processing.
Another variant is the all-swap lattice-reduction (ASLR) algorithm for complex-valued lattices, which processes all lattice basis vectors simultaneously within one iteration. Our novel systolic array can operate both algorithms with different external logic controls. In order to simplify the systolic array design, we replace the Lov´asz condition in the definition of LLL-reduced lattice with the looser Siegel condition. Simulation results show that for LR-aided linear detections, the bit-error-rate performance is still maintained with this relaxation. Comparisons between the two algorithms in terms of bit-error-rate performance, and average field-programmable gate array processing time in the systolic array are made, which shows that ASLR is a better choice for a systolic architecture, especially for systems with a large number of antennas.
분석정보
연월일 | 이력구분 | 이력상세 | 등재구분 |
---|---|---|---|
2023 | 평가예정 | 해외DB학술지평가 신청대상 (해외등재 학술지 평가) | |
2020-01-01 | 평가 | 등재학술지 유지 (해외등재 학술지 평가) | KCI등재 |
2005-01-01 | 평가 | SCI 등재 (등재후보1차) | KCI등재 |
2004-01-01 | 평가 | 등재후보학술지 유지 (등재후보2차) | KCI후보 |
2003-01-01 | 평가 | 등재후보 1차 PASS (등재후보1차) | KCI후보 |
2001-07-01 | 평가 | 등재후보학술지 선정 (신규평가) | KCI후보 |
기준연도 | WOS-KCI 통합IF(2년) | KCIF(2년) | KCIF(3년) |
---|---|---|---|
2016 | 0.74 | 0.09 | 0.53 |
KCIF(4년) | KCIF(5년) | 중심성지수(3년) | 즉시성지수 |
0.42 | 0.34 | 0.264 | 0.02 |
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