VLIW 프로세서에서의 효율적인 분기 수행 = On Efficient Branch Execution for VLIW Processors
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발행연도
1998
작성언어
Korean
KDC
569
등재정보
구)KCI등재(통합)
자료형태
학술저널
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수록면
1348-1358(11쪽)
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대부분의 상용 마이크로프로세서들은 명령어 수준의 병렬 처리(Instruction-Level Parallelism) 기법을 이용하여 큰 성능 향상을 이루고 있으나 분기 명령어의 처리 문제는 지속적인 성능 향상을 가로 막는 중요한 문제 중의 하나이다. 더욱이 비수치계산 프로그램에서는 분기 명령어의 높은 수행 비율로 인해서 분기 명령과 일반 데이타 명령어의 효율적인 병렬 수행을 필요로 한다. 본 논문에서는 이러한 병렬 수행을 지원하는 프로세서 구조와 이와 관련된 컴파일러 기법의 성능을 평가하고 분석한다. 특히 두가지 프로세서 구조인 ‘조건 수행’과 ‘조건 레지스터 파일’의 유무에 따라 네가지 조합의 분기 수행 구조를 제안하고 그 성능을 SPARC 기반의 VLIW (Very Long Instruction Word) 실험 환경에서 대형 정수 벤치마크를 이용하여 평가한다. 우리의 실험 결과에 따르면 다수의 조건 레지스터를 갖추고 조건 수행을 지원하며 컴파일러에 의한 분기 명령어의 추측 코드 재배치를 허락한 경우는 조건 레지스터 파일이 없이 조건 수행을 시도한 경우에 비해서 평균 16%의 성능 향상을 가지고 왔고 조건 레지스터 파일 없이 무조건 수행한 경우에 비해서는 40% 성능 향상이 가능하였다. 조건 레지스터와 조건 수행를 지원하는 프로세서에서 컴파일러는 불필요한 명령어의 순차화와 추측 코드 이동을 줄일 수 있어 보다 효율적인 VLIW 코드를 생성할 수 있음을 수행 싸이클의 자세한 분석을 통해 확인할 수 있었다.
더보기Modem microprocessors exploit instruction-level-parallelism (ILP) in order to achieve higher performance, yet ILP is often limited by problems caused by branch instructions. Especially in non-numerical code, it is required to execute a branch with independent data instructions in parallel due to high frequency of branches. In this paper, we evaluate architectural features for branch ILP such as ‘conditional execution’ and ‘condition registers’, and related compiler techniques on a SPARC-based VLIW environment. We propose four architectural modes for branch execution based on conditional execution and conditional registers and evaluate their performance impact. Our experimental results indicate that with conditional execution and conditional registers when branch reordering is allowed, we can get 16% performance improvement compared to conditional execution without conditional registers, and 40% performance improvement compared to unconditional execution without conditional registers. We found our scheduling compiler produces more efficient VLIW code with the two architectural features because they can remove unnecessary serialization of instructions and can reduce the useless speculative code motion.
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