KCI등재
DLL을 이용한 다중 변조 비율 확산대역클록 발생기 = Spread Spectrum Clock Generator with Multi Modulation Rate Using DLL (Delay Locked Loop)
저자
신대중 (DOESTEK Co., Ltd.) ; 유병재 (공주대학교) ; 김태진 (DOESTEK Co., Ltd.) ; 조현묵 (공주대학교) ; Shin, Dae-Jung ; Yu, Byeong-Jae ; Kim, Tae-Jin ; Cho, Hyun-Mook
발행기관
학술지명
권호사항
발행연도
2011
작성언어
Korean
주제어
등재정보
KCI등재
자료형태
학술저널
수록면
23-28(6쪽)
KCI 피인용횟수
1
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제공처
본 논문에서는 CMOS 회로를 이용한 스프레드 스펙트럼 클록 발생기(SSCG)를 제안하고 구현하였다. 지연고정루프(DLL)의 저역통과필터(LPF)에 스프레드 스펙트럼 클럭 변조 로직에 의해 조절되는 전하펌프를 연결하여 전압 제어지연로직(VCDL)에 가해지는 제어전압을 조절함으로써 주파수의 변화를 유도하는 방법을 사용하였다. 이와 같은 구조에서는 변조 비율을 조절하기 위한 부가적인 회로가 필요없기 때문에 레이아웃 면적이 작아지게 되고 전력소모가 작아지는 장점을 갖는다. 스프레드 스펙트럼 클록 발생기는 UMC 0.25um 공정을 이용하여 시뮬레이션 및 레이아웃을 수행하였으며 전체 면적은 290um${\times}$120um^2 이다.
더보기This paper describes design and implementation of a spread spectrum clock generator(SSCG). The proposed architecture generates the spread spectrum clock controlling a input voltage signal for VCDL(Voltage Controlled Delay Line). Spread charge pump is controlled by the SSC modulation logic block provides a control signal to VCDL through LPF in DLL. By using this architecture, chip area and power consumption can be reduced because it is not necessary additional circuit to control modulation rate. This circuit has been designed and fabricated using the UMC 0.25um CMOS technology. The chip occupies an area of 290${\times}$120um^2.
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연월일 | 이력구분 | 이력상세 | 등재구분 |
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2005-10-17 | 학술지명변경 | 외국어명 : 미등록 -> Journal of IKEEE | KCI후보 |
2005-05-30 | 학술지등록 | 한글명 : 전기전자학회논문지외국어명 : 미등록 | KCI후보 |
2005-03-25 | 학회명변경 | 한글명 : (사) 한국전기전자학회 -> 한국전기전자학회영문명 : 미등록 -> Institute of Korean Electrical and Electronics Engineers | KCI후보 |
2005-01-01 | 평가 | 등재후보 1차 PASS (등재후보1차) | KCI후보 |
2004-01-01 | 평가 | 등재후보 1차 FAIL (등재후보1차) | KCI후보 |
2003-01-01 | 평가 | 등재후보학술지 선정 (신규평가) | KCI후보 |
기준연도 | WOS-KCI 통합IF(2년) | KCIF(2년) | KCIF(3년) |
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2016 | 0.3 | 0.3 | 0.29 |
KCIF(4년) | KCIF(5년) | 중심성지수(3년) | 즉시성지수 |
0.24 | 0.22 | 0.262 | 0.17 |
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