HiPi 버스를 사용한 멀티프로세서 시스템에서 캐쉬 코히어런스 프로토콜의 성능평가에 관한 연구 = A Study on the Perforamnce Analysis of Cache Coherence Protocols in a Multiprocessor System Using HiPi Bus
저자
金永川 (전북대학교 공과대학 컴퓨터공학과)
발행기관
학술지명
권호사항
발행연도
1992
작성언어
Korean
KDC
028.630
자료형태
학술저널
수록면
201-210(10쪽)
제공처
소장기관
본 논문에는 pended 프로토콜을 가지는 HiPi 버스와 다중 캐쉬 메모리를 사용하는 멀티프로세서 시스템을 기술하고, 캐쉬 코히어런스 프로토콜에 따른 프로세서 효율면에서 시스템의 성능을 평가하였다. HiPi 버스는 ETRI에서 개발된 행망용 주전산기인 TICOM Ⅱ의 공유버스로 사용되기 위하여 개발되었다. HiPi 버스의 문제점 중 하나는 캐쉬 간의 전송을 허용하지 못하는 것이다. 이러한 문제점을 해결하기 위하여 캐쉬 간의 전송을 지원하도록 수정된 버스를 제안하였다. 또한 HiPi 버스를 갖는 시스템 각각의 성능을 여러 가지 캐쉬 코히어런스 프로토콜을 적용하여 분석 비교하였다. 고려된 캐쉬 코히어런스 프로토콜은 Write-Through, write-Once, Berkely, Synapse, Illinois, Firefly, Dragon이다. 캐쉬 코ㅇ히어런스 프로토콜을 분석하기 위하여 각각을 상태 천이도로 나타내었으며, 상태의 확률을 구하기 위하여 Markov 정적 상태도를 이용하였다. 각 상태의 확률은 시뮬레이션에서 입력 값으로 사용하였고, 모델링과 시뮬레이션은 SLAM Ⅱ 심볼과 언어를 사용하였다.
In this paper, we describe a multiprocessor system using the HiPi bus with pended protocol and multiple cache memories, and evalute the performance of the system in terms of processor utilization for cache coherence protocols. The HiPi bus in delveloped as the shard bus of TICOM Ⅱ which is main computer system to establish a nation -wide computing netwirk in ETRI. One of the problems with the HiPi bus is that it dose not allow cache-to-cache transfer. In order to solve this problem, we propose the modofied HiPi bus which supports cache-to cache transfer. In addition, each performance of the system with HiPi bus and the modified HiPi bus are analyzed and compared applying various cache coherence protocol : Write -Through, Write- Once, Berkely, Synapse, Illinois, Firefly, and Dragon. Each of cache coherence protocol is descrided by the state diagram to analyze them, and the probaility of states is calculated by Markov steady state. The calculated probaility of state is used for input parameters of simulation, and Modeling and simulation are implemented and performed using SLAMⅡ.
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