단일 주파수 다이나믹 CMOS POS PLA의 설계에 관한 연구 = A Study on the single phase dynamic CMOS POS PLA
저자
동용배 (전자부품종합기술연구소)
발행기관
公州大學校工科大學生産技術硏究所(KONGJU NATIONAL UNIVERSITY INDUSTRIAL TECHNOLOGY RESEARCH INSTITUTE)
학술지명
권호사항
발행연도
1993
작성언어
Korean
KDC
504
자료형태
학술저널
수록면
185-195(11쪽)
제공처
이 논문은 단일 주파수로 동작하는 다이나믹 CMOS PLA의 두가지 형태에 대해서 설명한다. 이 PLA (Programmable Logic Array) 들은 triggered 디코더와 전하 분할(charge sharing)기술을 이용한 것으로 고속, 저전력 소모특징을 갖는다.
Triggered 디코터 사용에 의하여 기존 PLA에 있는 ground 스위치를 제거할 수 있으며 동작 속도를 증가 시킬수 있다. 전하 분할 기술의 사용에 의하여 csscading AND 게이트를 실현 할수 있다. 2.0um CMOS PLA 의 두가지 형태가 시뮬레이션 되었고, 이들의 결과는 기존 PLA의 속도 및 전력에서 우수함을 보였다. Triggered 2-bits 디코더를 사용한 2-POS PLA는 기존 PLA보다 1.8 및 2.2 배 빠르다. 48 입력 minterm 및 8 출력 minterm을 갖는 일반 PLA 경우에 POS 및 2-POS PLA 는 2.2 및 3.4 배 적은 전력 소모를 갖는다.
This paper presents two types of single phase dynamic CMOS NOR-NOR PLA. The PLAs use triggered decoders and charge sharing resulting in high speed circuits with low power dissipation. By using triggered decoders, ground switches can be eliminated, thus making this new design much faster and dissipate less power than single phase conventional CMOS PLAs. By using charge-sharing, a cascading AND gate can be implemented. The two types of 2. Oum CMOS PLA were simulated and their resulting delay-times were much less than that of a conventional single phase CMOS PLA. The POS PLA using triggered 1-bit decoders(three-valued logic)and the POS PLA using triggered 2-bit decoders are respectively, 1.8 and 2.2 time faster than the conventional PLA. For a typical PLA with 48 input minterms and 8 output minterms, and they have respectively, 2.2 and 3.4 times less power dissipation than the conventional PLA.
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